Cadence EncounterTiming System因其卓越的時(shí)序調(diào)試、精確性、全流程集成性、高效率和簽收（Signoff）分析而贏得了業(yè)內(nèi)領(lǐng)先企業(yè)的支持。
加州圣荷塞，2006年9月6日－ Cadence設(shè)計(jì)系統(tǒng)公司（NASDAQ: CDNS）今天進(jìn)一步拓展了Cadence® Encounter® 數(shù)字IC設(shè)計(jì)平臺(tái)的功能，公布了 Encounter Timing System。這套新系統(tǒng)為客戶提供了面向時(shí)序、信號(hào)完整性和功耗的統(tǒng)一視圖和單一來(lái)源——從設(shè)計(jì)和物理實(shí)現(xiàn)，到最后的簽收(Signoff)分析。它不僅滿足了實(shí)現(xiàn)和簽收分析的需要，前端設(shè)計(jì)團(tuán)隊(duì)還可以利用其全局時(shí)序調(diào)試功能，實(shí)現(xiàn)精確的根源分析和迅速的時(shí)序收斂，并且它還擁有著強(qiáng)大的圖形用戶界面。
通過(guò)Encounter Timing System，數(shù)字IC設(shè)計(jì)師可以克服不斷縮小的工藝節(jié)點(diǎn)帶來(lái)的困難，縮短上市時(shí)間、提高效率，將和信號(hào)完整性分析應(yīng)用到設(shè)計(jì)流程的各個(gè)方面，并降低總生產(chǎn)成本。
Cadence Encounter Timing System具備了CeltIC® NDC領(lǐng)先的信號(hào)完整性(SI)分析和悲觀剔除技術(shù)(pessimism removal)的全部?jī)?yōu)點(diǎn)，具備了達(dá)到簽收質(zhì)量的時(shí)序、延遲計(jì)算、電源完整性等功能，并且與Encounter Conformal技術(shù)緊密聯(lián)結(jié)，以在設(shè)計(jì)流程所有階段得到全局、系統(tǒng)級(jí)的時(shí)序視圖。其它功能包括關(guān)鍵路徑模擬、SPICE追蹤、電遷移分析、統(tǒng)計(jì)時(shí)序以及計(jì)算功耗優(yōu)化及低功耗設(shè)計(jì)架構(gòu)的能力。
為了方便設(shè)計(jì)師識(shí)別和找到時(shí)序問(wèn)題的來(lái)源，Encounter Timing System設(shè)計(jì)了強(qiáng)大的以圖形為基礎(chǔ)的時(shí)序調(diào)試功能，用于精確的根源分析和迅速的時(shí)序收斂。Encounter Timing System還支持第三方的格式，例如Liberty和SDC，并充分發(fā)揮了有效電流源模型（ECSM）的性能，這是業(yè)內(nèi)第一個(gè)、也是唯一一個(gè)開(kāi)放的、經(jīng)實(shí)際生產(chǎn)證明的高級(jí)延遲模型格式。其結(jié)果是前所未有的可用性、可預(yù)測(cè)性以及與實(shí)現(xiàn)和分析的相關(guān)性，并且它兼容業(yè)內(nèi)通用的設(shè)計(jì)流程，非常易于采用。
“我們與Cadence一起合作，在我們的65納米級(jí)TSMC 參考設(shè)計(jì)流程 7.0中驗(yàn)證了Encounter Timing System的信號(hào)完整性、靜態(tài)和統(tǒng)計(jì)時(shí)序分析功能�！迸_(tái)積電（TSE: 2330，NYSE: TSM）的設(shè)計(jì)服務(wù)市場(chǎng)部高級(jí)主管Ed Wan說(shuō)，“如今設(shè)計(jì)師可以使用能在設(shè)計(jì)流程中具有一致性的高級(jí)時(shí)序，并同時(shí)解決時(shí)序、信號(hào)完整性和功耗的互相依賴問(wèn)題�！�
“我們依靠Encounter時(shí)序引擎對(duì)我們最尖端的設(shè)計(jì)進(jìn)行時(shí)序優(yōu)化和最終簽收�！盇theros Communications（NASDAQ: ATHR）的設(shè)計(jì)工程師Tim Conners說(shuō)，“Encounter Timing System是對(duì)我們的設(shè)計(jì)實(shí)現(xiàn)和簽收流程的自然拓展，它的性能、貫穿流程的精確性，以及在時(shí)序和信號(hào)完整性簽收方面卓越的可用性，讓我們很自然地決定以其為標(biāo)準(zhǔn)�！�
“我們用過(guò)多種嚴(yán)格的基準(zhǔn)，發(fā)現(xiàn)Encounter Timing System在我們的數(shù)百萬(wàn)門級(jí)設(shè)計(jì)中達(dá)到了最高的性能和精確性�！盡agnum半導(dǎo)體公司的設(shè)計(jì)經(jīng)理Eka Laiman說(shuō)，“我們很滿意Encounter時(shí)序系統(tǒng)的易用性以及應(yīng)用工程支持，它能夠讓我們進(jìn)行迅速的轉(zhuǎn)型和改進(jìn)。Encounter時(shí)序系統(tǒng)非常適合我們的Cadence前端設(shè)計(jì)流程，加快了我們數(shù)字視頻錄像芯片的大批量上市時(shí)間。”
隨著客戶從90納米過(guò)渡到45納米設(shè)計(jì)方法，使設(shè)計(jì)實(shí)現(xiàn)和簽收具有相同時(shí)序視圖并非奢侈的要求，而是勢(shì)在必行的事。存在電氣效應(yīng)、芯片可變性和設(shè)計(jì)敏感性情況下，這些技術(shù)節(jié)點(diǎn)上傾向于無(wú)法達(dá)到時(shí)序收斂，這就對(duì)設(shè)計(jì)工具和專家的智慧提出了前所未有的要求。從算法級(jí)和全局上管理這種復(fù)雜度只是挑戰(zhàn)的一部分。提供時(shí)序調(diào)試工具，以使數(shù)字IC設(shè)計(jì)師能夠在無(wú)窮可能性的海洋中迅速而直觀地識(shí)別時(shí)序問(wèn)題的精確來(lái)源是另一個(gè)問(wèn)題。任何可行的時(shí)序解決方案都需要解決這兩個(gè)方面的問(wèn)題。
“Cadence Encounter數(shù)字IC設(shè)計(jì)平臺(tái)為90納米及以下級(jí)別復(fù)雜和低功耗設(shè)計(jì)提供了完整的RTL設(shè)計(jì)和實(shí)現(xiàn)流程。”Cadence研發(fā)部副總裁戴偉進(jìn)先生表示，“Encounter Timing System使我們?cè)跀?shù)字IC設(shè)計(jì)信號(hào)完整性解決方案的領(lǐng)導(dǎo)地位延伸至?xí)r序簽收領(lǐng)域，是Cadence在尖端技術(shù)開(kāi)發(fā)方面不斷投入資源的直接成果�！�
加州圣荷塞，2006年9月6日－ Cadence設(shè)計(jì)系統(tǒng)公司（NASDAQ: CDNS）今天進(jìn)一步拓展了Cadence® Encounter® 數(shù)字IC設(shè)計(jì)平臺(tái)的功能，公布了 Encounter Timing System。這套新系統(tǒng)為客戶提供了面向時(shí)序、信號(hào)完整性和功耗的統(tǒng)一視圖和單一來(lái)源——從設(shè)計(jì)和物理實(shí)現(xiàn)，到最后的簽收(Signoff)分析。它不僅滿足了實(shí)現(xiàn)和簽收分析的需要，前端設(shè)計(jì)團(tuán)隊(duì)還可以利用其全局時(shí)序調(diào)試功能，實(shí)現(xiàn)精確的根源分析和迅速的時(shí)序收斂，并且它還擁有著強(qiáng)大的圖形用戶界面。
通過(guò)Encounter Timing System，數(shù)字IC設(shè)計(jì)師可以克服不斷縮小的工藝節(jié)點(diǎn)帶來(lái)的困難，縮短上市時(shí)間、提高效率，將和信號(hào)完整性分析應(yīng)用到設(shè)計(jì)流程的各個(gè)方面，并降低總生產(chǎn)成本。
Cadence Encounter Timing System具備了CeltIC® NDC領(lǐng)先的信號(hào)完整性(SI)分析和悲觀剔除技術(shù)(pessimism removal)的全部?jī)?yōu)點(diǎn)，具備了達(dá)到簽收質(zhì)量的時(shí)序、延遲計(jì)算、電源完整性等功能，并且與Encounter Conformal技術(shù)緊密聯(lián)結(jié)，以在設(shè)計(jì)流程所有階段得到全局、系統(tǒng)級(jí)的時(shí)序視圖。其它功能包括關(guān)鍵路徑模擬、SPICE追蹤、電遷移分析、統(tǒng)計(jì)時(shí)序以及計(jì)算功耗優(yōu)化及低功耗設(shè)計(jì)架構(gòu)的能力。
為了方便設(shè)計(jì)師識(shí)別和找到時(shí)序問(wèn)題的來(lái)源，Encounter Timing System設(shè)計(jì)了強(qiáng)大的以圖形為基礎(chǔ)的時(shí)序調(diào)試功能，用于精確的根源分析和迅速的時(shí)序收斂。Encounter Timing System還支持第三方的格式，例如Liberty和SDC，并充分發(fā)揮了有效電流源模型（ECSM）的性能，這是業(yè)內(nèi)第一個(gè)、也是唯一一個(gè)開(kāi)放的、經(jīng)實(shí)際生產(chǎn)證明的高級(jí)延遲模型格式。其結(jié)果是前所未有的可用性、可預(yù)測(cè)性以及與實(shí)現(xiàn)和分析的相關(guān)性，并且它兼容業(yè)內(nèi)通用的設(shè)計(jì)流程，非常易于采用。
“我們與Cadence一起合作，在我們的65納米級(jí)TSMC 參考設(shè)計(jì)流程 7.0中驗(yàn)證了Encounter Timing System的信號(hào)完整性、靜態(tài)和統(tǒng)計(jì)時(shí)序分析功能�！迸_(tái)積電（TSE: 2330，NYSE: TSM）的設(shè)計(jì)服務(wù)市場(chǎng)部高級(jí)主管Ed Wan說(shuō)，“如今設(shè)計(jì)師可以使用能在設(shè)計(jì)流程中具有一致性的高級(jí)時(shí)序，并同時(shí)解決時(shí)序、信號(hào)完整性和功耗的互相依賴問(wèn)題�！�
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隨著客戶從90納米過(guò)渡到45納米設(shè)計(jì)方法，使設(shè)計(jì)實(shí)現(xiàn)和簽收具有相同時(shí)序視圖并非奢侈的要求，而是勢(shì)在必行的事。存在電氣效應(yīng)、芯片可變性和設(shè)計(jì)敏感性情況下，這些技術(shù)節(jié)點(diǎn)上傾向于無(wú)法達(dá)到時(shí)序收斂，這就對(duì)設(shè)計(jì)工具和專家的智慧提出了前所未有的要求。從算法級(jí)和全局上管理這種復(fù)雜度只是挑戰(zhàn)的一部分。提供時(shí)序調(diào)試工具，以使數(shù)字IC設(shè)計(jì)師能夠在無(wú)窮可能性的海洋中迅速而直觀地識(shí)別時(shí)序問(wèn)題的精確來(lái)源是另一個(gè)問(wèn)題。任何可行的時(shí)序解決方案都需要解決這兩個(gè)方面的問(wèn)題。
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本文鏈接：CADENCE推出高級(jí)時(shí)序簽收分析系統(tǒng)
http:leisuda.cn/news/2006-9/200696112545.html
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文章標(biāo)簽： CADENCE
0755-82905460
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